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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供:
对于晶振上的干扰,
) w# j) k0 c- O4 b0 x7 U+ Y! w2 Y
8 x7 r4 f" v' o- ~% K1 Z; J在某一点上严重超标,是怎么解决的
( u# f7 U" j2 u/ O- C) r. |( G. y1 T
谢谢
沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :
# y! L) W$ `! S- P! Q, [' j无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
! n7 ?4 ?2 T. p3 v
是的,好象没有接地的
/ i6 o7 _, r; R& O! g- X2 A" w8 d6 l9 z, b$ }- C3 @
是客户的板,没有仔细看的
4 u4 x( E* D6 H8 m$ u& [9 J' n8 ]# \0 w* `! D( [
是11.0592M这样的晶振
' O+ I  D! D9 Y5 X8 J2 |
8 T) X5 |4 H" z只有这一点是有问题的
1 w1 l& L+ X2 Q/ n
) {: q1 a; F6 c头痛啊
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验,你可试试+ ~. [! c* O) O4 [
1。晶振外壳接地$ Q7 L. S9 E8 T8 n) k
2。在不影响性能的情况下关联电阻在两端,以降低其幅度
; d/ w; f1 b/ e" U/ g& }4 l0 }3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
8 _3 R" n$ M2 f1 [. x0 ?$ |; q4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
+ R5 z: Y/ V; p! \2 g+ f5。在电源线上加CORE
5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
' Z" W. L% Y) h" {我的一点点经验,你可试试6 u5 S2 S3 N4 T
1。晶振外壳接地
% O, T* b' J4 Y- R- u: |! m+ v2。在不影响性能的情况下关联电阻在两端,以降低其幅度
4 i& o' q( k  d3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致6 J* {) O- F) k0 `/ }
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽9 T, a7 x& r( E
.......
+ {7 K6 j; Y! {+ O

8 u2 a7 T% q2 `2 c# }6 m謝謝,. O5 s+ N9 U, Q: S

" l9 C  O: C, I並聯電阻,一般是多大的呢?) V( F, @3 K8 y) R$ E( }
0 T6 w& K% I3 n2 P! {9 e
電源線有加的,信號線也有加,25*12*15的
6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
- w+ p% A, H, n0 o我的一点点经验,你可试试( U. q' B4 z% o6 E  x
1。晶振外壳接地
0 |; ]) s' @: l9 s2。在不影响性能的情况下关联电阻在两端,以降低其幅度8 e' a: ?# f: W. T5 Z1 L
3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致, A: D( e" @8 q' R
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽, `1 @4 ~% y/ e! u( b4 n
.......
哈哈!mypcb兄回来了!欢迎欢迎!以后还请多指教!
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地,接地的铜皮要比晶振的体积大,并且最好在接近电源处引此地线。另外很可能是布线引起的,并非晶振。
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :
0 o7 E6 r# {2 G7 j2 O+ }8 @9 `/ ^- K% {
4 j, I1 y- o0 X5 Q$ i; ~

& y( h- I  l% ^! H3 c謝謝,: Q2 p% z( R0 O6 w  \* y) n( P: i# {$ H
8 R) j- p! H& A5 v
.......
! O5 f0 S6 y+ f( r  d' G- V
1 q3 y7 Y9 E% R8 L, J$ P8 w% m
可先并一个1M的试试,看会不会有所改善
9#
发表于 2007-7-13 22:54 | 只看该作者
嗯,削减晶振的能量是一方面。另外,干扰是否可能由其他并排走的信号/控制线耦合而来?除了在电源线上加ferrite core,也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的,能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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