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[家电产品] 功率辐射的问题

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发表于 2007-7-6 08:55 | 显示全部楼层 |阅读模式
广东安规检测
有限公司提供:
对于晶振上的干扰,
4 r3 g* X9 D) u" `+ M' w
* Q/ F: }- o& p6 v  w( K, O在某一点上严重超标,是怎么解决的+ l  D  M7 S9 x! `

9 Q3 B1 x2 o! \谢谢
发表于 2007-7-6 09:54 | 显示全部楼层
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
 楼主| 发表于 2007-7-6 09:59 | 显示全部楼层
引用第2楼ds1983于2007-07-06 09:54发表的  :! \$ [: [8 s( ~& ^, B" ~+ H: T
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
3 H6 w3 o' s$ k0 N  O4 v! Q
是的,好象没有接地的) [* t3 Z/ {& n  ~# t' w
+ W2 C( q: o4 E! T2 E+ q+ ^
是客户的板,没有仔细看的
: b1 [, c; c: O, S; u% |5 H4 J( i' b9 H0 f3 p8 E5 r/ i( q6 T
是11.0592M这样的晶振
+ D- L; Q' C2 \' `8 M0 u- j: v0 @9 o& e. w' ]
只有这一点是有问题的
0 D. E5 J0 ^. N4 X4 h: e/ _7 y( A
头痛啊
发表于 2007-7-7 00:47 | 显示全部楼层
我的一点点经验,你可试试6 r4 r# W' Y$ M1 S0 p) b
1。晶振外壳接地
" R% H6 s3 w. z3 h- Z, a1 [2。在不影响性能的情况下关联电阻在两端,以降低其幅度
3 H$ ~9 e8 S$ Q6 T3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致$ h* A; K. t2 K* ^
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽; N7 u  G2 f$ S- u% f6 Y
5。在电源线上加CORE
 楼主| 发表于 2007-7-7 08:27 | 显示全部楼层
引用第4楼mypcb于2007-07-07 00:47发表的  :
0 J2 m, I+ H, X$ \7 [# s+ e1 Z我的一点点经验,你可试试
% P6 [9 {2 F  R9 K' A- p7 y1。晶振外壳接地  r- c6 ]- z6 ?& [  s( v: y  Y3 y
2。在不影响性能的情况下关联电阻在两端,以降低其幅度
" G; j. q( E7 F3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
& ]1 w# Y) W: m4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
2 L# {' c- b, C, ^* {3 ?.......
$ Q/ p1 v% Q6 p* ?. {$ C. A

- c/ m' k4 J) I, p& w6 e謝謝,
, Z) @3 k  k% x! V1 A
2 b* H& D4 b$ r並聯電阻,一般是多大的呢?+ t5 l* k2 O4 I% _
4 L1 p2 G5 G' _+ Y/ h/ M& }8 N
電源線有加的,信號線也有加,25*12*15的
发表于 2007-7-8 10:05 | 显示全部楼层
引用第4楼mypcb于2007-07-07 00:47发表的  :
% ^* B( [$ M; y. n* w6 s: j我的一点点经验,你可试试% T. V% i# S: b; S
1。晶振外壳接地1 v$ x/ |/ ]7 G. ?: W- F3 b
2。在不影响性能的情况下关联电阻在两端,以降低其幅度9 U' U3 ?% V. R$ k% q
3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致5 H- m/ i2 f, a1 Q% W8 ^. P
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
" G% l6 N- p' ~. A! |$ p8 l.......
哈哈!mypcb兄回来了!欢迎欢迎!以后还请多指教!
发表于 2007-7-8 14:53 | 显示全部楼层
晶振外壳接地,接地的铜皮要比晶振的体积大,并且最好在接近电源处引此地线。另外很可能是布线引起的,并非晶振。
发表于 2007-7-9 17:34 | 显示全部楼层
引用第5楼bamboolight于2007-07-07 08:27发表的  :
, F! U9 g9 S  s2 S
% Q- X% J3 r2 Z, y4 n: X0 K8 i
% Z* F/ o& I' @: z7 p! F2 f6 J) y1 Y  j. ~7 }# k4 `2 P2 a* G+ ^  T
謝謝,. r& O3 P) i) z' Q- v+ G- u( v

/ @0 G2 Z; D1 s7 n! U.......
- b  L) I' Y) n
4 O# |7 O% h+ @* o  z
可先并一个1M的试试,看会不会有所改善
发表于 2007-7-13 22:54 | 显示全部楼层
嗯,削减晶振的能量是一方面。另外,干扰是否可能由其他并排走的信号/控制线耦合而来?除了在电源线上加ferrite core,也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的,能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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