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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供:
对于晶振上的干扰,  m! O  Z8 j9 {! ?7 T

; I' U" D; _9 u; K: d+ t在某一点上严重超标,是怎么解决的  z- n/ S/ u% `1 W6 V  y- d

$ e3 R+ e* @7 w谢谢
沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :& R( e* Q% t8 {9 ?
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。

6 j, X  M( G$ ?" i是的,好象没有接地的1 b6 P- m  X% B! Z; G0 F
( V  k* y8 I# @4 B
是客户的板,没有仔细看的
3 F9 _7 Z- Z& M; C4 t% ~! T+ ^9 O
6 E  n3 d  e4 H; S' S是11.0592M这样的晶振
4 }5 S9 E8 w; {2 |* I3 ~8 A& f* z6 N* b- m* _4 m$ t, Z# P8 B
只有这一点是有问题的# ]& {& T4 T( {. {: i: y5 C5 b9 H
3 X7 V3 F+ V4 N4 U# T! u3 B- C
头痛啊
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验,你可试试2 R/ E  @$ I2 v; T- |5 z1 ^& `5 [" F
1。晶振外壳接地
8 G1 {# d) S9 x/ |2。在不影响性能的情况下关联电阻在两端,以降低其幅度
( x9 L: W/ f1 w* M# O3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
2 u% n3 f7 Z" {# f) K4。还不行就将整个晶振上方用铜片包住接地进行屏蔽# o# |* ]- i5 B- {5 g6 V0 f' C$ ?+ t
5。在电源线上加CORE
5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :/ L% e" |0 e8 H8 [/ k4 w# S/ ^# Q) i
我的一点点经验,你可试试0 t! X0 k2 C/ i4 l4 v9 I
1。晶振外壳接地  o7 }+ q$ [6 G$ ?5 Y
2。在不影响性能的情况下关联电阻在两端,以降低其幅度
1 h5 F+ }8 s( N- c0 P3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致" T- P2 d, v! u! ]
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽7 r. L1 \% u. Q2 }
.......

0 w' g2 a9 U- W3 ^+ @8 T  X# ]! {& M5 I
謝謝,- f' l: B2 O* A
9 K* M( w) j/ Z: Y
並聯電阻,一般是多大的呢?$ |! N# M( F4 f. l/ P) J

' m! {- ?7 `, S/ s電源線有加的,信號線也有加,25*12*15的
6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :. {  e! D; |$ J
我的一点点经验,你可试试
% O9 d% i4 ?. m( I" J1。晶振外壳接地
, \1 k) V1 h2 Z0 b& K2。在不影响性能的情况下关联电阻在两端,以降低其幅度
4 l7 ]8 w) {- I6 Y. z2 [3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致1 b' h* B: i7 V2 t/ w
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
/ M7 |9 Q1 S$ N/ N' C0 \3 u% O: r.......
哈哈!mypcb兄回来了!欢迎欢迎!以后还请多指教!
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地,接地的铜皮要比晶振的体积大,并且最好在接近电源处引此地线。另外很可能是布线引起的,并非晶振。
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :
1 \, G7 z9 ~# M3 w6 i& f" M  z- L5 c# _* ~# S. K
$ A* M3 {2 g. E; T

# W: a5 a8 `- N謝謝,7 f- c5 ^- [. L' U6 l; \5 P

7 c1 o3 d7 k6 U( v! }.......

' Y2 Y  f6 K! Z/ d& e
% m  N* R* ^0 ^+ K- Y9 r7 F4 o可先并一个1M的试试,看会不会有所改善
9#
发表于 2007-7-13 22:54 | 只看该作者
嗯,削减晶振的能量是一方面。另外,干扰是否可能由其他并排走的信号/控制线耦合而来?除了在电源线上加ferrite core,也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的,能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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