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[家电产品] 功率辐射的问题

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楼主
发表于 2007-7-6 08:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
广东安规检测
有限公司提供：
对于晶振上的干扰,& G* y7 E* C. s* k. D' `

5 a$ s  Q8 v6 \在某一点上严重超标,是怎么解决的
! I1 I" k0 Y( _0 S7 N  @: U+ r  J7 J
谢谢
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沙发
发表于 2007-7-6 09:54 | 只看该作者
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
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板凳
 楼主| 发表于 2007-7-6 09:59 | 只看该作者
引用第2楼ds1983于2007-07-06 09:54发表的  :0 N4 D% U# M: V6 m5 f; L# I
无源晶振要接地，可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。

! d+ [: O% ]1 _3 `是的,好象没有接地的
$ i8 W$ B+ h- D3 E' Z4 J1 G! H% f* h- c' @+ g8 {# Z% c; u
是客户的板,没有仔细看的/ s+ G: [2 }6 E: \' A

5 d" w$ ^. |2 e' O2 }! s是11.0592M这样的晶振) X* ?  L% p; k/ y& a* _# J

; ?3 D5 [/ g. }7 ]2 l' E" T( y* F只有这一点是有问题的, R: y6 g% F0 T9 ?( _1 s0 G" X2 B
- U5 n6 n5 S5 k" ^9 q! O" `
头痛啊
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mypcb
地板
发表于 2007-7-7 00:47 | 只看该作者
我的一点点经验，你可试试* m& [4 O# R6 X1 h, Y4 ?
1。晶振外壳接地& ~. k$ I: v- G
2。在不影响性能的情况下关联电阻在两端，以降低其幅度
( X9 x, X0 O2 @3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
  P  k0 K5 X+ a3 i! @* J4。还不行就将整个晶振上方用铜片包住接地进行屏蔽7 G4 {) X0 ~4 b0 p  D3 f( p
5。在电源线上加CORE
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5#
 楼主| 发表于 2007-7-7 08:27 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :
  z# N# d( u: i5 g1 @3 }( s8 Q( W我的一点点经验，你可试试
; [( i) F. \" O8 c/ R4 y1。晶振外壳接地
2 M, J+ V, _' U2。在不影响性能的情况下关联电阻在两端，以降低其幅度$ f1 m6 |) i/ m* y
3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致
3 j% {1 t; }5 `( R4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
- i4 v) g" `- ~: u3 S0 M.......

9 d* ]( t& I" {3 E2 \& H- r0 z' [3 u2 M2 @) J
謝謝，
: H" g2 @$ d+ [. V3 q/ I2 J, [7 j% P; n& J4 L7 p2 h
並聯電阻，一般是多大的呢？3 a- G% q& M1 t6 K. D$ V
* l  q9 n5 v4 ~3 ?
電源線有加的，信號線也有加，25*12*15的
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6#
发表于 2007-7-8 10:05 | 只看该作者
引用第4楼mypcb于2007-07-07 00:47发表的  :* L" L7 w) E9 K" M# y
我的一点点经验，你可试试
+ Q$ ^4 E% H7 f& {0 J( I1。晶振外壳接地7 c. `; Z6 e; ?; K/ U+ m3 E
2。在不影响性能的情况下关联电阻在两端，以降低其幅度4 H$ _1 T  a, j' w* A0 A) v" M
3。检查晶振是否靠近IC，保证引线尽量的短且粗细长短要尽量一致2 y% E" y. h- F, ?  F4 a  |: B
4。还不行就将整个晶振上方用铜片包住接地进行屏蔽! W# M7 [$ D* L8 S8 n: l
.......
哈哈！mypcb兄回来了！欢迎欢迎！以后还请多指教！
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CHDYZ
7#
发表于 2007-7-8 14:53 | 只看该作者
晶振外壳接地，接地的铜皮要比晶振的体积大，并且最好在接近电源处引此地线。另外很可能是布线引起的，并非晶振。
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mypcb
8#
发表于 2007-7-9 17:34 | 只看该作者
引用第5楼bamboolight于2007-07-07 08:27发表的  :' W% h: d8 L( I
  S  x( c9 S+ B  C) y
$ B; N+ C# }' z" `; D" I

- s1 _; T, S# M. @謝謝，
' X% v( x: y, {2 x0 @9 t- r2 l5 v
) S$ o$ i1 M$ ]7 e- W.......

4 o; P6 l1 z; h! \# e! l& P, d0 r1 }0 n  P& G9 P
可先并一个1M的试试,看会不会有所改善
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9#
发表于 2007-7-13 22:54 | 只看该作者
嗯，削减晶振的能量是一方面。另外，干扰是否可能由其他并排走的信号/控制线耦合而来？除了在电源线上加ferrite core，也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的，能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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