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[家电产品] 功率辐射的问题

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发表于 2007-7-6 08:55 | 显示全部楼层 |阅读模式
广东安规检测
有限公司提供:
对于晶振上的干扰,) ^% t0 X5 I7 p& ]0 ^+ k) H. K
5 ]# N  ]. g9 U9 P4 H
在某一点上严重超标,是怎么解决的
9 p5 N1 S- K6 K6 T8 ^  }& _# r
6 x, j2 k' l7 n# R5 w3 m谢谢
发表于 2007-7-6 09:54 | 显示全部楼层
无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。
 楼主| 发表于 2007-7-6 09:59 | 显示全部楼层
引用第2楼ds1983于2007-07-06 09:54发表的  :
1 U1 B1 L' W" Z, e% W" @& L. T无源晶振要接地,可以从外壳焊接到接地点。由于无源晶振未接地导致的超标现象很多。

! O, ^7 d6 c/ R$ [. N; C5 d是的,好象没有接地的3 x3 h6 z* ~- y
* I% v3 j+ k, |  a5 l3 F' n2 Y" k
是客户的板,没有仔细看的
6 G* `4 g, O9 D& s+ @+ z+ @5 M5 q  `" \% ^
是11.0592M这样的晶振
9 B$ a* G( d  ?$ |' B4 f# ]( g3 y2 M% q
只有这一点是有问题的( l  I/ J3 ~- i% z
+ U2 D6 g2 y0 j7 U' h! N
头痛啊
发表于 2007-7-7 00:47 | 显示全部楼层
我的一点点经验,你可试试, e) ~2 {* X; n4 M8 d
1。晶振外壳接地2 S* {( Q1 |5 q: p+ I
2。在不影响性能的情况下关联电阻在两端,以降低其幅度
$ ?8 r) a3 N, ~, J2 T0 ]3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
- t0 j+ `$ ^3 k/ o/ F4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
! ~) U: @- ~4 j1 y- P9 {5。在电源线上加CORE
 楼主| 发表于 2007-7-7 08:27 | 显示全部楼层
引用第4楼mypcb于2007-07-07 00:47发表的  :
7 a; p' o" a' G/ M, Q我的一点点经验,你可试试
/ x- V, X, C2 k: W, I' I1 s$ B1 p; V1。晶振外壳接地
; D% U7 l) N& C2。在不影响性能的情况下关联电阻在两端,以降低其幅度* V& s) d% v1 w3 ^" |; g- p
3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
) n; i% e+ Y* _- L; S8 H4。还不行就将整个晶振上方用铜片包住接地进行屏蔽
/ {0 E) y( H8 z.......
. M' o) W" N, O+ ^6 l% Z2 {

6 b+ g4 n5 J. F) N謝謝,7 n% J6 z; Q% }8 r; i/ `3 E

7 P4 S9 b9 K, i& c並聯電阻,一般是多大的呢?5 U# x+ E0 R! a- t5 M
1 y6 \0 G8 {/ E# ~6 M# ~3 W
電源線有加的,信號線也有加,25*12*15的
发表于 2007-7-8 10:05 | 显示全部楼层
引用第4楼mypcb于2007-07-07 00:47发表的  :( I# ], A  R/ I( m
我的一点点经验,你可试试8 T" F/ y; g% }" e, |
1。晶振外壳接地" P4 ?: V$ c- h+ C* V% v
2。在不影响性能的情况下关联电阻在两端,以降低其幅度
6 ]3 v6 j! F7 m' q& I9 r7 z3。检查晶振是否靠近IC,保证引线尽量的短且粗细长短要尽量一致
! u' f, V7 U! v  g  W& w4。还不行就将整个晶振上方用铜片包住接地进行屏蔽& S) c9 |% @, [
.......
哈哈!mypcb兄回来了!欢迎欢迎!以后还请多指教!
发表于 2007-7-8 14:53 | 显示全部楼层
晶振外壳接地,接地的铜皮要比晶振的体积大,并且最好在接近电源处引此地线。另外很可能是布线引起的,并非晶振。
发表于 2007-7-9 17:34 | 显示全部楼层
引用第5楼bamboolight于2007-07-07 08:27发表的  :8 V9 q* d4 v. ]2 V
* P) q7 i' x* k& a' E  E0 P

/ S! i* l+ O1 U2 R# e% C% b
; Z3 `( m" A* m- A  u; T( l% s謝謝,8 h4 ]! h$ P! s# L  y
, b( `0 V# s4 [; W0 K, C7 M4 q" d
.......
% B: e9 ?- Z  F; U
8 R% M% p* \2 S
可先并一个1M的试试,看会不会有所改善
发表于 2007-7-13 22:54 | 显示全部楼层
嗯,削减晶振的能量是一方面。另外,干扰是否可能由其他并排走的信号/控制线耦合而来?除了在电源线上加ferrite core,也可以试试在信号/控制线上加ferrite core、ferrite bead、瓷片电容等。效果总会有的,能否通过测试就多试试不同的参数组合吧。让客户一次次改PCB布线什么的太费时费力了。
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